摘要：一種多核處理器的數(shù)據(jù)管理方法及裝置，所述多核處理器包括處理器核心陣列和處理器核心互連結(jié)構(gòu)，所述處理器核心陣列包括多個(gè)處理器核心，所述處理器核心包括具有多個(gè)存儲(chǔ)單元的核內(nèi)存儲(chǔ)器，所述處理器核心互連結(jié)構(gòu)用于所述處理器核心陣列中任意兩處理器核心間的通信，所述方法包括：對(duì)所述處理器核心的核內(nèi)存儲(chǔ)器的存儲(chǔ)單元分配存儲(chǔ)地址；根據(jù)所述存儲(chǔ)單元的存儲(chǔ)地址在至少一個(gè)處理器核心的核內(nèi)存儲(chǔ)器和主存之間進(jìn)行數(shù)據(jù)傳輸。本發(fā)明提高了數(shù)據(jù)的讀寫效率，利用批量化的訪存方式，將多次數(shù)據(jù)訪問(wèn)合并，避免了零散訪問(wèn)主存的效率損失問(wèn)題，并提供了多種編址方式和相應(yīng)的數(shù)據(jù)傳輸方式，能夠滿足多種計(jì)算過(guò)程的應(yīng)用需要。
- 專利類型發(fā)明專利
- 申請(qǐng)人無(wú)錫江南計(jì)算技術(shù)研究所;
- 發(fā)明人李宏亮;鄭方;謝向輝;郝子宇;胡蘇太;唐勇;
- 地址214083 江蘇省無(wú)錫市濱湖區(qū)軍東新村030號(hào)
- 申請(qǐng)?zhí)?/b>CN201010508870.1
- 申請(qǐng)時(shí)間2010年10月12日
- 申請(qǐng)公布號(hào)CN102446159A
- 申請(qǐng)公布時(shí)間2012年05月09日
- 分類號(hào)G06F15/167(2006.01)I;G06F12/02(2006.01)I;
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