摘要：一種多核處理器及多核處理器組，包括至少一個(gè)主核、至少一個(gè)從核陣列、第一互連結(jié)構(gòu)和從核互連結(jié)構(gòu)，所述從核陣列包括多個(gè)從核，所述從核與主核異構(gòu)，其中，所述第一互連結(jié)構(gòu)和從核互連結(jié)構(gòu)用于所述主核與所述從核陣列間的通信，所述從核互連結(jié)構(gòu)還用于所述從核陣列中任意兩從核間的通信，作為一個(gè)優(yōu)選的技術(shù)方案，所述主核為通用處理器核，所述從核為微結(jié)構(gòu)和指令集經(jīng)過(guò)精簡(jiǎn)優(yōu)化的處理器核，且所述多核處理器集成在同一芯片上。本發(fā)明改善了處理器核之間的通信效率，提高了整個(gè)多核處理器的計(jì)算密度，實(shí)現(xiàn)了通用控制功能和高計(jì)算密度的均衡。
- 專利類(lèi)型發(fā)明專利
- 申請(qǐng)人無(wú)錫江南計(jì)算技術(shù)研究所;
- 發(fā)明人謝向輝;李宏亮;鄭方;過(guò)鋒;呂暉;胡蘇太;
- 地址214083 江蘇省無(wú)錫市濱湖區(qū)軍東新村030號(hào)
- 申請(qǐng)?zhí)?/b>CN201010508842.X
- 申請(qǐng)時(shí)間2010年10月12日
- 申請(qǐng)公布號(hào)CN102446158B
- 申請(qǐng)公布時(shí)間2013年09月18日
- 分類(lèi)號(hào)G06F15/167(2006.01)I;G06F9/50(2006.01)I;
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